Comparadores baseados em amplificadores operacionais

Amplificadores operacionais (amplificadores operacionais) podem ser configurados como comparadores operando-os em modo de malha aberta, onde o alto ganho amplifica a tensão de entrada diferencial para produzir uma saída binária que alterna entre os trilhos de alimentação com base no fato de o sinal de entrada exceder um limite de referência. Nesta configuração, nenhum feedback é aplicado, permitindo que o amplificador operacional funcione como um elemento de tomada de decisão para tarefas de comparação de tensão.

A configuração não inversora aplica o sinal de entrada ao terminal não inversor (+) e a tensão de referência ao terminal inversor (-); a saída fica alta (saturação positiva) quando a entrada excede a referência e baixa (saturação negativa) caso contrário. Por outro lado, a configuração inversora conecta o sinal de entrada ao terminal inversor (-) e a referência ao terminal não inversor (+), resultando na saída alta quando a entrada está abaixo da referência e baixa quando acima, invertendo assim a lógica de comparação.

Um esquema básico para definir o limite usa um divisor de tensão de dois resistores na entrada de referência. Para a configuração não inversora, conecte o resistor R1R_1R1​ da tensão de referência VrefV_{ref}Vref​ à entrada inversora e R2R_2R2​ da entrada inversora ao terra; a tensão limite é dada por

Isso divide VrefV_{ref}Vref​ para criar um nível de comparação preciso no terminal inversor.[20]

Uma vantagem importante dos comparadores baseados em amplificadores operacionais é seu baixo custo, já que os amplificadores operacionais de uso geral são onipresentes e prontamente disponíveis para prototipagem ou aplicações de baixo volume sem a necessidade de componentes especializados.[19] No entanto, eles sofrem de tempos de resposta mais lentos em comparação com comparadores dedicados, principalmente devido aos capacitores de compensação internos projetados para operação estável em circuito fechado, que introduzem atraso de fase e limitam as taxas de variação a cerca de 0,5 V/μs em dispositivos típicos. Além disso, a instabilidade potencial pode surgir do overdrive de entrada ou da carga capacitiva, e a oscilação de saída pode não interagir diretamente com os níveis lógicos digitais sem buffer.

Na configuração inversora, a inversão de fase ocorre porque a polaridade de saída é oposta à relação do sinal de entrada com o limite, o que pode complicar a lógica downstream. Isso pode ser mitigado adicionando um estágio inversor adicional, como um segundo amplificador operacional em uma configuração simples de buffer inversor, para restaurar a polaridade de saída desejada sem afetar significativamente a velocidade.

O amplificador operacional μA741, introduzido pela Fairchild Semiconductor em 1968, exemplifica o uso inicial de amplificadores operacionais de uso geral em aplicações comparativas durante o final dos anos 1960 e 1970, onde sua compensação interna e capacidade de deslocamento nulo o tornaram adequado para detecção de tensão básica em sistemas analógicos, apesar de sua modesta largura de banda de 1 MHz.

Comparadores Integrados Dedicados

Os comparadores integrados dedicados representam circuitos integrados específicos, otimizados especificamente para tarefas de comparação de tensão, oferecendo desempenho superior em velocidade e eficiência em comparação com a adaptação de amplificadores operacionais de uso geral. O LM339, lançado pela National Semiconductor no início dos anos 1970, marcou um marco significativo como um dos primeiros CIs comparadores quádruplos dedicados, projetado para aplicações multicanais com baixo consumo de energia e compatibilidade com níveis lógicos TTL. Este desenvolvimento abordou as limitações dos designs anteriores baseados em amplificadores discretos ou operacionais, integrando vários comparadores independentes em um único chip, permitindo soluções compactas e econômicas para processamento de sinal.

Internamente, esses CIs empregam estágios de entrada diferenciais otimizados, normalmente usando pares de transistores bipolares para alta impedância e ganho de entrada, seguidos por estágios de saída sem os capacitores de compensação de frequência necessários em amplificadores operacionais para estabilidade na operação em malha fechada. Esta ausência de compensação permite transições rápidas de sinal, já que o circuito prioriza o ganho de malha aberta e a taxa de variação em relação à amplificação linear, resultando em velocidades de comutação inadequadas para feedback, mas ideais para decisões binárias.

Os principais exemplos incluem o comparador único LM311, o comparador duplo LM393 e o comparador quádruplo LM339, todos parte da duradoura família LMx39 originalmente da National Semiconductor (agora Texas Instruments). O LM311 possui um pacote DIP de 8 pinos com pino 1 como equilíbrio, pino 2 como entrada inversora, pino 3 como entrada não inversora, pino 4 como V- / estroboscópio, pino 5 como equilíbrio / estroboscópio, pino 6 como saída do emissor, pino 7 como saída do coletor (coletor aberto) e pino 8 como V+. Em uma aplicação básica, as entradas se conectam às tensões a serem comparadas, a saída diminui quando a entrada não inversora excede a inversora e um resistor pull-up (por exemplo, 10 kΩ para V+) converte o coletor aberto em um sinal lógico alto. O LM393, em um pacote de 8 pinos, possui canais duplos com pinos 1 e 7 como saídas, pinos 2/3 e 5/6 como entradas inversoras/não inversoras para cada um, pino 4 para GND e pino 8 para VCC; um circuito simples espelha o LM311, mas suporta duas comparações por IC. O LM339 estende isso para quatro canais em um pacote de 14 pinos com a seguinte pinagem: pino 1 (saída 1), pino 2 (saída 2), pino 3 (V +), pino 4 (entrada inversora 2), pino 5 (entrada não inversora 2), pino 6 (entrada inversora 1), pino 7 (entrada não inversora 1), pino 8 (entrada inversora 3), pino 9 (entrada não inversora 3), pino 10 (entrada inversora 4), pino 11 (entrada não inversora 4), pino 12 (GND), pino 13 (saída 4), pino 14 (saída 3). O circuito básico usa conexões de entrada e pull-ups semelhantes em cada saída para configurações de comparação múltipla.

Configurações de saída

Os comparadores empregam várias configurações de saída para fazer interface com circuitos subsequentes, cada um oferecendo características elétricas distintas e compensações em capacidade, velocidade e compatibilidade do inversor. Essas configurações determinam como o comparador aumenta ou diminui a saída em resposta às comparações de entrada, influenciando fatores como oscilação de tensão, tratamento de corrente e a capacidade de conectar vários dispositivos.[12]

A saída push-pull padrão, também conhecida como totem-pole, utiliza transistores complementares - um para fornecer corrente (pull up) e outro para absorver corrente (pull down) - permitindo oscilação completa de tensão de trilho a trilho sem um pull-up externo resistor. Essa configuração fornece tempos de subida e descida simétricos, normalmente abaixo de 100 ns, e suporta correntes de fonte e de drenagem de até vários miliamperes, tornando-a adequada para acionar portas lógicas ou cargas diretamente dos trilhos de alimentação. Em implementações de totem, muitas vezes usando dois transistores NPN em um arranjo empilhado para o estágio superior, a saída é direcionada ativamente para V+ (alto) ou terra (baixo), alcançando baixa impedância de saída para ambos os estados, mas evitando a ligação direta de múltiplas saídas devido a riscos potenciais de curto-circuito.

As saídas quase complementares representam uma variante de push-pull onde os estágios complementares são assimétricos, como o uso de um par Darlington de transistores NPN para o estágio superior (fonte) emparelhado com um único NPN para o estágio inferior (afundamento), para simplificar a fabricação enquanto aproxima o desempenho complementar completo. Esta abordagem oferece vantagens em termos de custo e integração para processos bipolares, mas pode introduzir uma ligeira não-linearidade ou uma eficiência de fornecimento reduzida em comparação com o verdadeiro push-pull complementar, embora ainda forneça oscilação entre trilhos e acionamento ativo em ambas as direções.[29]

Em contraste, a saída de coletor aberto (ou dreno aberto em equivalentes CMOS) depende de um único transistor NPN cujo coletor é deixado aberto, permitindo que a saída absorva a corrente para o terra quando baixa, mas flutue alta quando desligada, necessitando de um resistor pull-up externo para definir o estado alto. Esquematicamente, o transistor de saída se conecta entre o pino de saída e o terra, com o resistor pull-up ligado à saída a uma tensão de terminação, permitindo a mudança de nível se a tensão pull-up exceder a alimentação do comparador (por exemplo, até 36 V para dispositivos como o LM139). O valor do resistor pull-up é selecionado como Rpullup=Vsupply−VOLIloadR_{\text{pullup}} = \frac{V_{\text{supply}} - V_{\text{OL}}}{I_{\text{load}}}Rpullup​=Iload​Vsupply​−VOL​​, onde VOLV_{\text{OL}}VOL​ é a baixa tensão de saída (normalmente 0,4 V) e IloadI_{\text{load}}Iload​ é a corrente necessária do drive, equilibrando a velocidade com a dissipação de potência e o tempo de subida influenciado pela capacitância da carga. Esta configuração é excelente na lógica OR com fio, onde várias saídas de coletor aberto podem ser vinculadas a um único pull-up, permitindo que qualquer nível ativo de nível baixo puxe o barramento para nível baixo enquanto as saídas inativas flutuam, facilitando conexões de vários dispositivos, como barramentos de detecção de erros ou comparadores de janela sem gating adicional.

As saídas de coletor aberto ganharam popularidade nos projetos compatíveis com TTL da década de 1970, como a série SN54/7400, devido à sua versatilidade em aplicações OR com fio e compatibilidade com sistemas digitais em expansão, conforme detalhado nos primeiros guias de projeto TTL. Para proteção, muitos comparadores incorporam diodos de fixação de saída ou estruturas ESD para limitar excursões de tensão, evitando danos por sobretensão em pinos de coletor aberto (por exemplo, fixação em VCC + 0,3 V) ou curtos em estágios push-pull. Semelhante às saídas de comparadores dedicados, os projetos baseados em amplificadores operacionais geralmente usam estágios push-pull para acionamento comparável, mas podem não ter a velocidade otimizada de comparadores especializados.

Mecanismos de histerese

A histerese nos comparadores é introduzida através de realimentação positiva, que estabelece dois limites de comutação distintos: um limite inferior (Vth-) para sinais de entrada crescentes e um limite superior (Vth+) para sinais descendentes. Este mecanismo evita oscilações rápidas de saída causadas por ruído em torno de um único limite, pois a saída permanece estável até que a entrada cruze o limite apropriado na direção oposta.[5][32]

A implementação normalmente envolve uma rede de resistores que alimenta uma parte da tensão de saída de volta para uma das entradas do comparador. Em uma configuração inversora básica, o sinal de entrada é aplicado à entrada inversora (com V_ref também considerado na entrada inversora ou ajustado); um resistor de feedback (R1) conecta a saída à entrada não inversora, enquanto um segundo resistor (R2) conecta a entrada não inversora ao terra (ou a uma tensão de referência). A tensão de histerese (Vhys) é dada por:

onde VoutswingV_{out_{swing}}Voutswing​​ é a oscilação da tensão de saída (por exemplo, de 0 V até a tensão de alimentação). Os limites são derivados da seguinte forma: para uma entrada crescente, quando a saída é baixa (0 V), Vth−=Vref−VhysV_{th-} = V_{ref} - VhysVth−​=Vref​−Vhys; para uma entrada em queda, quando a saída é alta (VoutswingV_{out_{swing}}Voutswing​​), Vth+=Vref+VhysV_{th+} = V_{ref} + VhysVth+​=Vref​+Vhys, assumindo uma tensão de referência VrefV_{ref}Vref​ efetivamente na entrada inversora. Esse feedback positivo muda a referência efetiva com base no estado de saída, criando o comportamento de limite duplo.[5][33]

Existem duas configurações principais: gatilhos Schmitt não inversores e inversores. No tipo não inversor, o sinal de entrada é aplicado ao terminal não inversor, e a realimentação ajusta o limite ali, resultando em uma saída que segue a lógica de entrada com histerese. A configuração inversora aplica a entrada ao terminal inversor, com feedback para o terminal não inversor, invertendo a lógica e fornecendo a mesma separação de limite. Ambos os tipos alcançam rejeição de ruído, mas diferem no tratamento da polaridade do sinal.[34][5]

O principal benefício da histerese é a imunidade aprimorada a ruídos, especialmente para sinais de entrada ruidosos ou de variação lenta, onde evita disparos falsos e garante transições limpas. No entanto, introduz uma desvantagem de resolução reduzida, uma vez que a faixa de entrada efetiva é estreitada pela largura da histerese, limitando potencialmente a precisão em aplicações que exigem detecção precisa.[5][32]

Por exemplo, considere R1 = 1 MΩ (feedback), R2 = 10 kΩ (para o solo) e Voutswing=5V_{out_{swing}} = 5Voutswing​​=5 V, com Vref=2,5V_{ref} = 2,5Vref​=2,5 V. Então, Vhys=10×1031×106+10×103×5≈0,05Vhys = \frac{10 \ves 10^3}{1 \vezes 10^6 + 10 \ves 10^3} \vezes 5 \aprox 0,05Vhys=1×106+10×10310×103​×5≈0,05 V, produzindo Vth+≈2,55V_{th+} \aproximadamente 2,55Vth+​≈2,55 V e Vth−≈2,45V_{th-} \aproximadamente 2,45Vth−​≈2,45 V.[33]

Características de velocidade e potência

O atraso de propagação em comparadores é definido como o intervalo de tempo desde o ponto médio (50%) da transição da tensão de entrada até o ponto médio (50%) da transição da tensão de saída correspondente.[35] Esta métrica quantifica a velocidade de resposta do dispositivo às alterações de entrada e é influenciada por fatores como a tensão de overdrive de entrada (o excesso além do limite) e a taxa de variação do sinal de entrada. Por exemplo, um overdrive mais baixo aumenta o atraso devido à redução da entrada diferencial, enquanto transições de entrada mais lentas podem estender o atraso efetivo, limitando a taxa na qual o estágio diferencial interno responde. No comparador duplo LM393, o atraso de propagação típico é de 300 ns sob condições de entrada de oscilação lógica TTL, referência de 1,4 V e alimentação de 5 V com uma carga de 5,1 kΩ. Comparadores bipolares mais rápidos, como o LM311, atingem um atraso de propagação de cerca de 200 ns com overdrive semelhante.

A taxa de variação para comparadores refere-se à taxa máxima de variação da tensão de saída (dV/dt), normalmente expressa em V/µs, que determina a rapidez com que a saída pode oscilar entre os níveis lógicos durante as transições. Os tempos de subida e descida, medidos entre 10% e 90% da oscilação do produto, estão intimamente relacionados e muitas vezes limitados por esta taxa de variação; por exemplo, o tempo de subida pode ser aproximado como 0,8 × (oscilação da tensão de saída)/taxa de variação. Para evitar erros de limitação de variação ou integração de ruído durante entradas lentas, o tempo mínimo de transição de entrada deve exceder o atraso inerente do comparador, mas permanecer rápido o suficiente para minimizar a compensação do ruído térmico - idealmente, taxas de variação de entrada acima de 1 V/µs para dispositivos de alta velocidade para garantir a passagem precisa do limite sem incerteza prolongada. Comparadores bipolares como o LM311 exibem taxas de variação em torno de 30 V/µs, resultando em tempos de subida/descida de ~0,2 µs para oscilações completas de 5 V, enquanto designs CMOS modernos podem atingir taxas mais altas de até 10 V/µs em processos otimizados.

O consumo de energia nos comparadores compreende a corrente quiescente (Iq, o consumo de estado estacionário sem comutação de entrada) e a potência dinâmica das transições de saída, calculada como P_dinâmica ≈ V_supply × I_switch × f_switch, onde I_switch é a corrente de comutação e f_switch é a frequência de transição. Os comparadores CMOS de baixo consumo priorizam o Iq mínimo, geralmente na faixa de nA a µA, permitindo aplicações operadas por bateria; por exemplo, o LMC6762 consome 12 µA típico total (6 µA por comparador) a 5 V. Em contraste, designs bipolares tradicionais como o LM393 consomem 0,4 mA Iq típico (2 mW a 5 V), com contribuições dinâmicas adicionadas durante a operação de alta frequência.

Existe uma compensação fundamental entre velocidade e potência no projeto do comparador: atrasos de propagação mais rápidos requerem correntes de polarização mais altas, aumentando a potência quiescente e dinâmica, enquanto variantes de baixa potência sacrificam a velocidade. Os processos bipolares se destacam em velocidade devido à maior transcondutância, mas incorrem em maior potência (por exemplo, vários mA Iq para atrasos ns), enquanto o CMOS oferece eficiência superior com µA Iq, mas respostas tipicamente mais lentas (faixa µs), a menos que seja dimensionado para nós avançados. Os híbridos BiCMOS atenuam isso combinando velocidade bipolar para caminhos críticos com lógica CMOS de baixa potência, alcançando atrasos inferiores a 100 ns em níveis de mW.[40]

Modos Operacionais e Referências

Os comparadores operam em modo contínuo ou sincronizado, dependendo dos requisitos da aplicação para resposta em tempo real ou sincronização. No modo contínuo, o comparador monitora continuamente os sinais de entrada e produz uma saída que reflete a comparação instantânea, tornando-o adequado para sinais analógicos sem restrições de tempo.[43] Os comparadores com clock ou travados incorporam um mecanismo sample-and-hold que captura a entrada nas bordas do clock, seguido por uma fase de regeneração onde a saída é resolvida e travada até o próximo ciclo de clock; este modo inclui um tempo de regeneração finito determinado pelo ganho e carga do circuito de trava.

Muitos comparadores integrados apresentam tensões de referência internas para simplificar o projeto do circuito e melhorar a precisão, muitas vezes geradas usando circuitos bandgap que produzem saídas estáveis ​​em torno de 1,2 V ou outros níveis fixos. Essas referências são derivadas da energia do bandgap de silício, combinando componentes proporcionais à temperatura absoluta (PTAT) e complementares à temperatura absoluta (CTAT) para minimizar o desvio térmico. A precisão de tal referência sobre uma mudança de temperatura ΔT é aproximada por Vref±ΔT×tempcoV_{\text{ref}} \pm \Delta T \times \text{tempco}Vref​±ΔT×tempco, onde tempco é o coeficiente de temperatura normalmente expresso em ppm/°C ou V/°C.[45] Por exemplo, os módulos comparadores da Microchip incluem referências de bandgap internas selecionáveis ​​de 1,2 V, 0,6 V ou 0,2 V para comparação de limiar.[46]

Os comparadores de janela ampliam a funcionalidade básica definindo uma faixa de entrada aceitável entre os limites superior e inferior, normalmente implementados usando dois comparadores cujas saídas são combinadas com portas lógicas como AND ou OR. O primeiro comparador monitora o limite superior (saída alta se entrada < limite superior), enquanto o segundo controla o limite inferior (saída alta se entrada > limite inferior); um AND lógico dessas saídas é acionado quando a entrada cai dentro da janela, fornecendo detecção de sobre/subtensão.[47]

Os comparadores com clock oferecem vantagens em sistemas sincronizados, como conversores analógico-digitais (ADCs), onde reduzem os riscos de metaestabilidade ao amostrar entradas em momentos precisos e permitir que a regeneração resolva decisões próximas do limite sem oscilação. Os modos contínuos, por outro lado, são excelentes no processamento de sinais em tempo real, onde a resposta imediata é crítica, evitando a latência relacionada ao relógio.[48] Os exemplos incluem comparadores de saída LVDS como o LMH7220, que mantém uma referência interna de 1,2 V para estabilidade de modo comum de saída, e dispositivos com limites integrados para aplicações de sinalização diferencial.

Circuitos de detecção de sinal

Os comparadores desempenham um papel crucial em circuitos de detecção de sinal, fornecendo decisões rápidas de limiar para identificar níveis de tensão específicos, transições ou desvios em sinais de entrada, permitindo aplicações em processamento de formas de onda e sistemas de medição. Esses circuitos aproveitam a capacidade do comparador de comparar um sinal de entrada com uma tensão de referência, produzindo uma saída binária que indica se o sinal atende a critérios predefinidos, como cruzar zero ou cair dentro de uma faixa.[51]

Um detector de cruzamento zero usa um comparador para converter uma onda senoidal CA em uma onda quadrada, detectando pontos onde o sinal de entrada cruza a referência de tensão zero. Nesta configuração, a entrada inversora do comparador é conectada ao terra (0 V), enquanto a entrada não inversora recebe o sinal CA, muitas vezes atenuado para proteção; a saída alterna para alto ou baixo cada vez que a entrada cruza zero, marcando efetivamente as transições de fase. Esta configuração é particularmente útil para detecção de fase em circuitos de sincronização, onde a saída de onda quadrada pode acionar contadores ou temporizadores para medir o tempo relativo a uma forma de onda de referência.

Em aplicações de detecção nula, como medições de ponte de Wheatstone, um comparador serve como um indicador sensível de desvios do equilíbrio, detectando a polaridade da tensão nula diferencial (Vnull), que representa o desequilíbrio entre os braços da ponte. A saída indica a direção do desequilíbrio (alto ou baixo com base no sinal de Vnull), permitindo ajuste ou monitoramento em sistemas de resistência de precisão ou extensômetros.[51] Esta configuração opera para discriminar polaridades para correção de equilíbrio.

Um detector de janela emprega dois comparadores para determinar se um sinal de entrada está dentro de uma faixa de tensão definida, fornecendo uma saída somente quando o sinal está entre os limites superior (Valto) e inferior (Vbaixo). O primeiro comparador tem o sinal em sua entrada não inversora e Vlow na entrada inversora, com saída alta se o sinal exceder Vlow; o segundo tem Vhigh em sua entrada não inversora e o sinal na entrada inversora, gerando saída alta se o sinal estiver abaixo de Vhigh; suas saídas são logicamente AND para produzir alto quando Vlow <Vin <Vhigh.[52] Essa abordagem de limite duplo é essencial para detecção dentro da faixa em circuitos de monitoramento, como proteção de sobre/subtensão.[53]

Um detector de valor absoluto, funcionando como um retificador de onda completa, usa um comparador para detectar a polaridade do sinal de entrada e controlar interruptores analógicos que direcionam o sinal ou sua versão invertida (através de um estágio de amplificador operacional) para a saída, garantindo que apenas a magnitude positiva seja produzida. O comparador compara a entrada com o terra, acionando interruptores (por exemplo, FETs ou transistores CMOS) para selecionar o caminho apropriado: para entradas positivas, o sinal passa diretamente; para negativo, é invertido antes da comutação. Este circuito é valioso para processamento de sinais CA onde informações de magnitude são necessárias sem distorção de fase, como no monitoramento de energia.[54]

As considerações práticas nesses circuitos de detecção incluem a implementação de filtragem de entrada para mitigar o ruído e evitar falsos disparos de picos transitórios ou bordas de subida lenta. Filtros passa-baixa, como redes RC nas entradas do comparador, atenuam o ruído de alta frequência enquanto preservam as transições relevantes do sinal, reduzindo saídas errôneas em ambientes ruidosos. Além disso, a incorporação da histerese, conforme discutido nos recursos de projeto do comparador, aumenta a estabilidade ao criar limites de comutação distintos, minimizando ainda mais as falsas detecções de flutuações de entrada.[55]

Circuitos de Conversão e Geração

Os comparadores desempenham um papel fundamental nos circuitos de geração de sinais, particularmente em osciladores de relaxação que produzem ondas quadradas usando uma rede de temporização RC. Nesse circuito, a saída do comparador aciona a rede RC, enquanto um divisor resistivo fornece feedback positivo para a entrada não inversora, estabelecendo limites de comutação superior e inferior para histerese. Quando a tensão do capacitor excede o limite superior durante o carregamento, a saída muda para baixo, revertendo a descarga do capacitor através do resistor em direção ao trilho de alimentação inferior; ele então muda para alto ao atingir o limite inferior, completando o ciclo e gerando uma onda quadrada periódica. Esta configuração garante oscilações estáveis ​​sem exigir correspondência precisa de componentes, tornando-a adequada para aplicações de baixa frequência, como circuitos de temporização.

O período de oscilação pode ser derivado da dinâmica exponencial de carga e descarga do capacitor. Considere uma alimentação unipolar VCCV_{CC}VCC​ com limite inferior Vlow=βVCCV_{low} = \beta V_{CC}Vlow​=βVCC​ e limite superior Vhigh=(1−β)VCCV_{high} = (1 - \beta) V_{CC}Vhigh​=(1−β)VCC​, onde 0<β<0,50 < \beta < 0,50<β<0,5. Durante o carregamento de VlowV_{low}Vlow​ em direção a VCCV_{CC}VCC​, a tensão do capacitor segue VC(t)=VCC−(VCC−Vlow)e−t/RCV_C(t) = V_{CC} - (V_{CC} - V_{low}) e^{-t / RC}VC​(t)=VCC​−(VCC​−Vlow​)e−t/RC; configuração VC(tcharge)=VhighV_C(t_{charge}) = V_{high}VC​(tcharge​)=Vhigh​ produz tcharge=RCln⁡(VCC−VlowVCC−Vhigh)=RCln⁡(1−ββ)t_{charge} = RC \ln \left( \frac{V_{CC} - V_{low}}{V_{CC} - V_{high}} \right) = RC \ln \left( \frac{1 - \beta}{\beta} \right)tcharge​=RCln(VCC​−Vhigh​VCC​−Vlow​​)=RCln(β1−β​). Da mesma forma, durante a descarga de VhighV_{high}Vhigh​ em direção ao solo (0 V), VC(t)=Vhighe−t/RCV_C(t) = V_{high} e^{-t / RC}VC​(t)=Vhigh​e−t/RC, e definir VC(tdischarge)=VlowV_C(t_{discharge}) = V_{low}VC​(tdischarge​)=Vlow​ dá tdischarge=RCln⁡(VhighVlow)=RCln⁡(1−ββ)t_{discharge} = RC \ln \left( \frac{V_{high}}{V_{low}} \right) = RC \ln \left( \frac{1 - \beta}{\beta} \right)tdischarge​=RCln(Vlow​Vhigh​​)=RCln(β1−β​). O período total é, portanto, T=2RCln⁡(1−ββ)T = 2 RC \ln \left( \frac{1 - \beta}{\beta} \right)T=2RCln(β1−β​), e a frequência é f=1T=12RCln⁡(1−ββ)f = \frac{1}{T} = \frac{1}{2 RC \ln \left( \frac{1 - \beta}{\beta} \right)}f=T1​=2RCln(β1−β​)1​. Para o caso simétrico típico β=1/3\beta = 1/3β=1/3, isso simplifica para f≈0,72RCf \approx \frac{0,72}{RC}f≈RC0,72​, como ln⁡(2)≈0,693\ln(2) \approx 0,693ln(2)≈0,693.[56]

Na conversão analógico-digital, os comparadores formam o núcleo dos ADCs flash, permitindo a quantização de sinais analógicos em alta velocidade. Um flash ADC emprega comparadores 2n − 12 ^ n - 12n − 1, cada um referenciando uma derivação de tensão exclusiva de uma escada divisora ​​resistiva que abrange a faixa de entrada, para comparar simultaneamente o sinal de entrada com esses níveis. As saídas do comparador produzem um código de termômetro – uma representação unária onde as saídas acima do nível de entrada são altas e abaixo são baixas – indicando o compartimento de quantização. Esse código é então convertido em binário de n bits por meio de um codificador, permitindo taxas de conversão rápidas de até gigasamples por segundo, embora ao custo de um crescimento exponencial de hardware com resolução; por exemplo, um flash ADC de 8 bits requer 255 comparadores.

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Comparadores baseados em amplificadores operacionais

Amplificadores operacionais (amplificadores operacionais) podem ser configurados como comparadores operando-os em modo de malha aberta, onde o alto ganho amplifica a tensão de entrada diferencial para produzir uma saída binária que alterna entre os trilhos de alimentação com base no fato de o sinal de entrada exceder um limite de referência. Nesta configuração, nenhum feedback é aplicado, permitindo que o amplificador operacional funcione como um elemento de tomada de decisão para tarefas de comparação de tensão.

A configuração não inversora aplica o sinal de entrada ao terminal não inversor (+) e a tensão de referência ao terminal inversor (-); a saída fica alta (saturação positiva) quando a entrada excede a referência e baixa (saturação negativa) caso contrário. Por outro lado, a configuração inversora conecta o sinal de entrada ao terminal inversor (-) e a referência ao terminal não inversor (+), resultando na saída alta quando a entrada está abaixo da referência e baixa quando acima, invertendo assim a lógica de comparação.

Um esquema básico para definir o limite usa um divisor de tensão de dois resistores na entrada de referência. Para a configuração não inversora, conecte o resistor R1R_1R1​ da tensão de referência VrefV_{ref}Vref​ à entrada inversora e R2R_2R2​ da entrada inversora ao terra; a tensão limite é dada por

Isso divide VrefV_{ref}Vref​ para criar um nível de comparação preciso no terminal inversor.[20]

Uma vantagem importante dos comparadores baseados em amplificadores operacionais é seu baixo custo, já que os amplificadores operacionais de uso geral são onipresentes e prontamente disponíveis para prototipagem ou aplicações de baixo volume sem a necessidade de componentes especializados.[19] No entanto, eles sofrem de tempos de resposta mais lentos em comparação com comparadores dedicados, principalmente devido aos capacitores de compensação internos projetados para operação estável em circuito fechado, que introduzem atraso de fase e limitam as taxas de variação a cerca de 0,5 V/μs em dispositivos típicos. Além disso, a instabilidade potencial pode surgir do overdrive de entrada ou da carga capacitiva, e a oscilação de saída pode não interagir diretamente com os níveis lógicos digitais sem buffer.

Na configuração inversora, a inversão de fase ocorre porque a polaridade de saída é oposta à relação do sinal de entrada com o limite, o que pode complicar a lógica downstream. Isso pode ser mitigado adicionando um estágio inversor adicional, como um segundo amplificador operacional em uma configuração simples de buffer inversor, para restaurar a polaridade de saída desejada sem afetar significativamente a velocidade.

O amplificador operacional μA741, introduzido pela Fairchild Semiconductor em 1968, exemplifica o uso inicial de amplificadores operacionais de uso geral em aplicações comparativas durante o final dos anos 1960 e 1970, onde sua compensação interna e capacidade de deslocamento nulo o tornaram adequado para detecção de tensão básica em sistemas analógicos, apesar de sua modesta largura de banda de 1 MHz.

Comparadores Integrados Dedicados

Os comparadores integrados dedicados representam circuitos integrados específicos, otimizados especificamente para tarefas de comparação de tensão, oferecendo desempenho superior em velocidade e eficiência em comparação com a adaptação de amplificadores operacionais de uso geral. O LM339, lançado pela National Semiconductor no início dos anos 1970, marcou um marco significativo como um dos primeiros CIs comparadores quádruplos dedicados, projetado para aplicações multicanais com baixo consumo de energia e compatibilidade com níveis lógicos TTL. Este desenvolvimento abordou as limitações dos designs anteriores baseados em amplificadores discretos ou operacionais, integrando vários comparadores independentes em um único chip, permitindo soluções compactas e econômicas para processamento de sinal.

Internamente, esses CIs empregam estágios de entrada diferenciais otimizados, normalmente usando pares de transistores bipolares para alta impedância e ganho de entrada, seguidos por estágios de saída sem os capacitores de compensação de frequência necessários em amplificadores operacionais para estabilidade na operação em malha fechada. Esta ausência de compensação permite transições rápidas de sinal, já que o circuito prioriza o ganho de malha aberta e a taxa de variação em relação à amplificação linear, resultando em velocidades de comutação inadequadas para feedback, mas ideais para decisões binárias.

Os principais exemplos incluem o comparador único LM311, o comparador duplo LM393 e o comparador quádruplo LM339, todos parte da duradoura família LMx39 originalmente da National Semiconductor (agora Texas Instruments). O LM311 possui um pacote DIP de 8 pinos com pino 1 como equilíbrio, pino 2 como entrada inversora, pino 3 como entrada não inversora, pino 4 como V- / estroboscópio, pino 5 como equilíbrio / estroboscópio, pino 6 como saída do emissor, pino 7 como saída do coletor (coletor aberto) e pino 8 como V+. Em uma aplicação básica, as entradas se conectam às tensões a serem comparadas, a saída diminui quando a entrada não inversora excede a inversora e um resistor pull-up (por exemplo, 10 kΩ para V+) converte o coletor aberto em um sinal lógico alto. O LM393, em um pacote de 8 pinos, possui canais duplos com pinos 1 e 7 como saídas, pinos 2/3 e 5/6 como entradas inversoras/não inversoras para cada um, pino 4 para GND e pino 8 para VCC; um circuito simples espelha o LM311, mas suporta duas comparações por IC. O LM339 estende isso para quatro canais em um pacote de 14 pinos com a seguinte pinagem: pino 1 (saída 1), pino 2 (saída 2), pino 3 (V +), pino 4 (entrada inversora 2), pino 5 (entrada não inversora 2), pino 6 (entrada inversora 1), pino 7 (entrada não inversora 1), pino 8 (entrada inversora 3), pino 9 (entrada não inversora 3), pino 10 (entrada inversora 4), pino 11 (entrada não inversora 4), pino 12 (GND), pino 13 (saída 4), pino 14 (saída 3). O circuito básico usa conexões de entrada e pull-ups semelhantes em cada saída para configurações de comparação múltipla.

Configurações de saída

Os comparadores empregam várias configurações de saída para fazer interface com circuitos subsequentes, cada um oferecendo características elétricas distintas e compensações em capacidade, velocidade e compatibilidade do inversor. Essas configurações determinam como o comparador aumenta ou diminui a saída em resposta às comparações de entrada, influenciando fatores como oscilação de tensão, tratamento de corrente e a capacidade de conectar vários dispositivos.[12]

A saída push-pull padrão, também conhecida como totem-pole, utiliza transistores complementares - um para fornecer corrente (pull up) e outro para absorver corrente (pull down) - permitindo oscilação completa de tensão de trilho a trilho sem um pull-up externo resistor. Essa configuração fornece tempos de subida e descida simétricos, normalmente abaixo de 100 ns, e suporta correntes de fonte e de drenagem de até vários miliamperes, tornando-a adequada para acionar portas lógicas ou cargas diretamente dos trilhos de alimentação. Em implementações de totem, muitas vezes usando dois transistores NPN em um arranjo empilhado para o estágio superior, a saída é direcionada ativamente para V+ (alto) ou terra (baixo), alcançando baixa impedância de saída para ambos os estados, mas evitando a ligação direta de múltiplas saídas devido a riscos potenciais de curto-circuito.

As saídas quase complementares representam uma variante de push-pull onde os estágios complementares são assimétricos, como o uso de um par Darlington de transistores NPN para o estágio superior (fonte) emparelhado com um único NPN para o estágio inferior (afundamento), para simplificar a fabricação enquanto aproxima o desempenho complementar completo. Esta abordagem oferece vantagens em termos de custo e integração para processos bipolares, mas pode introduzir uma ligeira não-linearidade ou uma eficiência de fornecimento reduzida em comparação com o verdadeiro push-pull complementar, embora ainda forneça oscilação entre trilhos e acionamento ativo em ambas as direções.[29]

Em contraste, a saída de coletor aberto (ou dreno aberto em equivalentes CMOS) depende de um único transistor NPN cujo coletor é deixado aberto, permitindo que a saída absorva a corrente para o terra quando baixa, mas flutue alta quando desligada, necessitando de um resistor pull-up externo para definir o estado alto. Esquematicamente, o transistor de saída se conecta entre o pino de saída e o terra, com o resistor pull-up ligado à saída a uma tensão de terminação, permitindo a mudança de nível se a tensão pull-up exceder a alimentação do comparador (por exemplo, até 36 V para dispositivos como o LM139). O valor do resistor pull-up é selecionado como Rpullup=Vsupply−VOLIloadR_{\text{pullup}} = \frac{V_{\text{supply}} - V_{\text{OL}}}{I_{\text{load}}}Rpullup​=Iload​Vsupply​−VOL​​, onde VOLV_{\text{OL}}VOL​ é a baixa tensão de saída (normalmente 0,4 V) e IloadI_{\text{load}}Iload​ é a corrente necessária do drive, equilibrando a velocidade com a dissipação de potência e o tempo de subida influenciado pela capacitância da carga. Esta configuração é excelente na lógica OR com fio, onde várias saídas de coletor aberto podem ser vinculadas a um único pull-up, permitindo que qualquer nível ativo de nível baixo puxe o barramento para nível baixo enquanto as saídas inativas flutuam, facilitando conexões de vários dispositivos, como barramentos de detecção de erros ou comparadores de janela sem gating adicional.

As saídas de coletor aberto ganharam popularidade nos projetos compatíveis com TTL da década de 1970, como a série SN54/7400, devido à sua versatilidade em aplicações OR com fio e compatibilidade com sistemas digitais em expansão, conforme detalhado nos primeiros guias de projeto TTL. Para proteção, muitos comparadores incorporam diodos de fixação de saída ou estruturas ESD para limitar excursões de tensão, evitando danos por sobretensão em pinos de coletor aberto (por exemplo, fixação em VCC + 0,3 V) ou curtos em estágios push-pull. Semelhante às saídas de comparadores dedicados, os projetos baseados em amplificadores operacionais geralmente usam estágios push-pull para acionamento comparável, mas podem não ter a velocidade otimizada de comparadores especializados.

Mecanismos de histerese

A histerese nos comparadores é introduzida através de realimentação positiva, que estabelece dois limites de comutação distintos: um limite inferior (Vth-) para sinais de entrada crescentes e um limite superior (Vth+) para sinais descendentes. Este mecanismo evita oscilações rápidas de saída causadas por ruído em torno de um único limite, pois a saída permanece estável até que a entrada cruze o limite apropriado na direção oposta.[5][32]

A implementação normalmente envolve uma rede de resistores que alimenta uma parte da tensão de saída de volta para uma das entradas do comparador. Em uma configuração inversora básica, o sinal de entrada é aplicado à entrada inversora (com V_ref também considerado na entrada inversora ou ajustado); um resistor de feedback (R1) conecta a saída à entrada não inversora, enquanto um segundo resistor (R2) conecta a entrada não inversora ao terra (ou a uma tensão de referência). A tensão de histerese (Vhys) é dada por:

onde VoutswingV_{out_{swing}}Voutswing​​ é a oscilação da tensão de saída (por exemplo, de 0 V até a tensão de alimentação). Os limites são derivados da seguinte forma: para uma entrada crescente, quando a saída é baixa (0 V), Vth−=Vref−VhysV_{th-} = V_{ref} - VhysVth−​=Vref​−Vhys; para uma entrada em queda, quando a saída é alta (VoutswingV_{out_{swing}}Voutswing​​), Vth+=Vref+VhysV_{th+} = V_{ref} + VhysVth+​=Vref​+Vhys, assumindo uma tensão de referência VrefV_{ref}Vref​ efetivamente na entrada inversora. Esse feedback positivo muda a referência efetiva com base no estado de saída, criando o comportamento de limite duplo.[5][33]

Existem duas configurações principais: gatilhos Schmitt não inversores e inversores. No tipo não inversor, o sinal de entrada é aplicado ao terminal não inversor, e a realimentação ajusta o limite ali, resultando em uma saída que segue a lógica de entrada com histerese. A configuração inversora aplica a entrada ao terminal inversor, com feedback para o terminal não inversor, invertendo a lógica e fornecendo a mesma separação de limite. Ambos os tipos alcançam rejeição de ruído, mas diferem no tratamento da polaridade do sinal.[34][5]

O principal benefício da histerese é a imunidade aprimorada a ruídos, especialmente para sinais de entrada ruidosos ou de variação lenta, onde evita disparos falsos e garante transições limpas. No entanto, introduz uma desvantagem de resolução reduzida, uma vez que a faixa de entrada efetiva é estreitada pela largura da histerese, limitando potencialmente a precisão em aplicações que exigem detecção precisa.[5][32]

Por exemplo, considere R1 = 1 MΩ (feedback), R2 = 10 kΩ (para o solo) e Voutswing=5V_{out_{swing}} = 5Voutswing​​=5 V, com Vref=2,5V_{ref} = 2,5Vref​=2,5 V. Então, Vhys=10×1031×106+10×103×5≈0,05Vhys = \frac{10 \ves 10^3}{1 \vezes 10^6 + 10 \ves 10^3} \vezes 5 \aprox 0,05Vhys=1×106+10×10310×103​×5≈0,05 V, produzindo Vth+≈2,55V_{th+} \aproximadamente 2,55Vth+​≈2,55 V e Vth−≈2,45V_{th-} \aproximadamente 2,45Vth−​≈2,45 V.[33]

Características de velocidade e potência

O atraso de propagação em comparadores é definido como o intervalo de tempo desde o ponto médio (50%) da transição da tensão de entrada até o ponto médio (50%) da transição da tensão de saída correspondente.[35] Esta métrica quantifica a velocidade de resposta do dispositivo às alterações de entrada e é influenciada por fatores como a tensão de overdrive de entrada (o excesso além do limite) e a taxa de variação do sinal de entrada. Por exemplo, um overdrive mais baixo aumenta o atraso devido à redução da entrada diferencial, enquanto transições de entrada mais lentas podem estender o atraso efetivo, limitando a taxa na qual o estágio diferencial interno responde. No comparador duplo LM393, o atraso de propagação típico é de 300 ns sob condições de entrada de oscilação lógica TTL, referência de 1,4 V e alimentação de 5 V com uma carga de 5,1 kΩ. Comparadores bipolares mais rápidos, como o LM311, atingem um atraso de propagação de cerca de 200 ns com overdrive semelhante.

A taxa de variação para comparadores refere-se à taxa máxima de variação da tensão de saída (dV/dt), normalmente expressa em V/µs, que determina a rapidez com que a saída pode oscilar entre os níveis lógicos durante as transições. Os tempos de subida e descida, medidos entre 10% e 90% da oscilação do produto, estão intimamente relacionados e muitas vezes limitados por esta taxa de variação; por exemplo, o tempo de subida pode ser aproximado como 0,8 × (oscilação da tensão de saída)/taxa de variação. Para evitar erros de limitação de variação ou integração de ruído durante entradas lentas, o tempo mínimo de transição de entrada deve exceder o atraso inerente do comparador, mas permanecer rápido o suficiente para minimizar a compensação do ruído térmico - idealmente, taxas de variação de entrada acima de 1 V/µs para dispositivos de alta velocidade para garantir a passagem precisa do limite sem incerteza prolongada. Comparadores bipolares como o LM311 exibem taxas de variação em torno de 30 V/µs, resultando em tempos de subida/descida de ~0,2 µs para oscilações completas de 5 V, enquanto designs CMOS modernos podem atingir taxas mais altas de até 10 V/µs em processos otimizados.

O consumo de energia nos comparadores compreende a corrente quiescente (Iq, o consumo de estado estacionário sem comutação de entrada) e a potência dinâmica das transições de saída, calculada como P_dinâmica ≈ V_supply × I_switch × f_switch, onde I_switch é a corrente de comutação e f_switch é a frequência de transição. Os comparadores CMOS de baixo consumo priorizam o Iq mínimo, geralmente na faixa de nA a µA, permitindo aplicações operadas por bateria; por exemplo, o LMC6762 consome 12 µA típico total (6 µA por comparador) a 5 V. Em contraste, designs bipolares tradicionais como o LM393 consomem 0,4 mA Iq típico (2 mW a 5 V), com contribuições dinâmicas adicionadas durante a operação de alta frequência.

Existe uma compensação fundamental entre velocidade e potência no projeto do comparador: atrasos de propagação mais rápidos requerem correntes de polarização mais altas, aumentando a potência quiescente e dinâmica, enquanto variantes de baixa potência sacrificam a velocidade. Os processos bipolares se destacam em velocidade devido à maior transcondutância, mas incorrem em maior potência (por exemplo, vários mA Iq para atrasos ns), enquanto o CMOS oferece eficiência superior com µA Iq, mas respostas tipicamente mais lentas (faixa µs), a menos que seja dimensionado para nós avançados. Os híbridos BiCMOS atenuam isso combinando velocidade bipolar para caminhos críticos com lógica CMOS de baixa potência, alcançando atrasos inferiores a 100 ns em níveis de mW.[40]

Modos Operacionais e Referências

Os comparadores operam em modo contínuo ou sincronizado, dependendo dos requisitos da aplicação para resposta em tempo real ou sincronização. No modo contínuo, o comparador monitora continuamente os sinais de entrada e produz uma saída que reflete a comparação instantânea, tornando-o adequado para sinais analógicos sem restrições de tempo.[43] Os comparadores com clock ou travados incorporam um mecanismo sample-and-hold que captura a entrada nas bordas do clock, seguido por uma fase de regeneração onde a saída é resolvida e travada até o próximo ciclo de clock; este modo inclui um tempo de regeneração finito determinado pelo ganho e carga do circuito de trava.

Muitos comparadores integrados apresentam tensões de referência internas para simplificar o projeto do circuito e melhorar a precisão, muitas vezes geradas usando circuitos bandgap que produzem saídas estáveis ​​em torno de 1,2 V ou outros níveis fixos. Essas referências são derivadas da energia do bandgap de silício, combinando componentes proporcionais à temperatura absoluta (PTAT) e complementares à temperatura absoluta (CTAT) para minimizar o desvio térmico. A precisão de tal referência sobre uma mudança de temperatura ΔT é aproximada por Vref±ΔT×tempcoV_{\text{ref}} \pm \Delta T \times \text{tempco}Vref​±ΔT×tempco, onde tempco é o coeficiente de temperatura normalmente expresso em ppm/°C ou V/°C.[45] Por exemplo, os módulos comparadores da Microchip incluem referências de bandgap internas selecionáveis ​​de 1,2 V, 0,6 V ou 0,2 V para comparação de limiar.[46]

Os comparadores de janela ampliam a funcionalidade básica definindo uma faixa de entrada aceitável entre os limites superior e inferior, normalmente implementados usando dois comparadores cujas saídas são combinadas com portas lógicas como AND ou OR. O primeiro comparador monitora o limite superior (saída alta se entrada < limite superior), enquanto o segundo controla o limite inferior (saída alta se entrada > limite inferior); um AND lógico dessas saídas é acionado quando a entrada cai dentro da janela, fornecendo detecção de sobre/subtensão.[47]

Os comparadores com clock oferecem vantagens em sistemas sincronizados, como conversores analógico-digitais (ADCs), onde reduzem os riscos de metaestabilidade ao amostrar entradas em momentos precisos e permitir que a regeneração resolva decisões próximas do limite sem oscilação. Os modos contínuos, por outro lado, são excelentes no processamento de sinais em tempo real, onde a resposta imediata é crítica, evitando a latência relacionada ao relógio.[48] Os exemplos incluem comparadores de saída LVDS como o LMH7220, que mantém uma referência interna de 1,2 V para estabilidade de modo comum de saída, e dispositivos com limites integrados para aplicações de sinalização diferencial.

Circuitos de detecção de sinal

Os comparadores desempenham um papel crucial em circuitos de detecção de sinal, fornecendo decisões rápidas de limiar para identificar níveis de tensão específicos, transições ou desvios em sinais de entrada, permitindo aplicações em processamento de formas de onda e sistemas de medição. Esses circuitos aproveitam a capacidade do comparador de comparar um sinal de entrada com uma tensão de referência, produzindo uma saída binária que indica se o sinal atende a critérios predefinidos, como cruzar zero ou cair dentro de uma faixa.[51]

Um detector de cruzamento zero usa um comparador para converter uma onda senoidal CA em uma onda quadrada, detectando pontos onde o sinal de entrada cruza a referência de tensão zero. Nesta configuração, a entrada inversora do comparador é conectada ao terra (0 V), enquanto a entrada não inversora recebe o sinal CA, muitas vezes atenuado para proteção; a saída alterna para alto ou baixo cada vez que a entrada cruza zero, marcando efetivamente as transições de fase. Esta configuração é particularmente útil para detecção de fase em circuitos de sincronização, onde a saída de onda quadrada pode acionar contadores ou temporizadores para medir o tempo relativo a uma forma de onda de referência.

Em aplicações de detecção nula, como medições de ponte de Wheatstone, um comparador serve como um indicador sensível de desvios do equilíbrio, detectando a polaridade da tensão nula diferencial (Vnull), que representa o desequilíbrio entre os braços da ponte. A saída indica a direção do desequilíbrio (alto ou baixo com base no sinal de Vnull), permitindo ajuste ou monitoramento em sistemas de resistência de precisão ou extensômetros.[51] Esta configuração opera para discriminar polaridades para correção de equilíbrio.

Um detector de janela emprega dois comparadores para determinar se um sinal de entrada está dentro de uma faixa de tensão definida, fornecendo uma saída somente quando o sinal está entre os limites superior (Valto) e inferior (Vbaixo). O primeiro comparador tem o sinal em sua entrada não inversora e Vlow na entrada inversora, com saída alta se o sinal exceder Vlow; o segundo tem Vhigh em sua entrada não inversora e o sinal na entrada inversora, gerando saída alta se o sinal estiver abaixo de Vhigh; suas saídas são logicamente AND para produzir alto quando Vlow <Vin <Vhigh.[52] Essa abordagem de limite duplo é essencial para detecção dentro da faixa em circuitos de monitoramento, como proteção de sobre/subtensão.[53]

Um detector de valor absoluto, funcionando como um retificador de onda completa, usa um comparador para detectar a polaridade do sinal de entrada e controlar interruptores analógicos que direcionam o sinal ou sua versão invertida (através de um estágio de amplificador operacional) para a saída, garantindo que apenas a magnitude positiva seja produzida. O comparador compara a entrada com o terra, acionando interruptores (por exemplo, FETs ou transistores CMOS) para selecionar o caminho apropriado: para entradas positivas, o sinal passa diretamente; para negativo, é invertido antes da comutação. Este circuito é valioso para processamento de sinais CA onde informações de magnitude são necessárias sem distorção de fase, como no monitoramento de energia.[54]

As considerações práticas nesses circuitos de detecção incluem a implementação de filtragem de entrada para mitigar o ruído e evitar falsos disparos de picos transitórios ou bordas de subida lenta. Filtros passa-baixa, como redes RC nas entradas do comparador, atenuam o ruído de alta frequência enquanto preservam as transições relevantes do sinal, reduzindo saídas errôneas em ambientes ruidosos. Além disso, a incorporação da histerese, conforme discutido nos recursos de projeto do comparador, aumenta a estabilidade ao criar limites de comutação distintos, minimizando ainda mais as falsas detecções de flutuações de entrada.[55]

Circuitos de Conversão e Geração

Os comparadores desempenham um papel fundamental nos circuitos de geração de sinais, particularmente em osciladores de relaxação que produzem ondas quadradas usando uma rede de temporização RC. Nesse circuito, a saída do comparador aciona a rede RC, enquanto um divisor resistivo fornece feedback positivo para a entrada não inversora, estabelecendo limites de comutação superior e inferior para histerese. Quando a tensão do capacitor excede o limite superior durante o carregamento, a saída muda para baixo, revertendo a descarga do capacitor através do resistor em direção ao trilho de alimentação inferior; ele então muda para alto ao atingir o limite inferior, completando o ciclo e gerando uma onda quadrada periódica. Esta configuração garante oscilações estáveis ​​sem exigir correspondência precisa de componentes, tornando-a adequada para aplicações de baixa frequência, como circuitos de temporização.

O período de oscilação pode ser derivado da dinâmica exponencial de carga e descarga do capacitor. Considere uma alimentação unipolar VCCV_{CC}VCC​ com limite inferior Vlow=βVCCV_{low} = \beta V_{CC}Vlow​=βVCC​ e limite superior Vhigh=(1−β)VCCV_{high} = (1 - \beta) V_{CC}Vhigh​=(1−β)VCC​, onde 0<β<0,50 < \beta < 0,50<β<0,5. Durante o carregamento de VlowV_{low}Vlow​ em direção a VCCV_{CC}VCC​, a tensão do capacitor segue VC(t)=VCC−(VCC−Vlow)e−t/RCV_C(t) = V_{CC} - (V_{CC} - V_{low}) e^{-t / RC}VC​(t)=VCC​−(VCC​−Vlow​)e−t/RC; configuração VC(tcharge)=VhighV_C(t_{charge}) = V_{high}VC​(tcharge​)=Vhigh​ produz tcharge=RCln⁡(VCC−VlowVCC−Vhigh)=RCln⁡(1−ββ)t_{charge} = RC \ln \left( \frac{V_{CC} - V_{low}}{V_{CC} - V_{high}} \right) = RC \ln \left( \frac{1 - \beta}{\beta} \right)tcharge​=RCln(VCC​−Vhigh​VCC​−Vlow​​)=RCln(β1−β​). Da mesma forma, durante a descarga de VhighV_{high}Vhigh​ em direção ao solo (0 V), VC(t)=Vhighe−t/RCV_C(t) = V_{high} e^{-t / RC}VC​(t)=Vhigh​e−t/RC, e definir VC(tdischarge)=VlowV_C(t_{discharge}) = V_{low}VC​(tdischarge​)=Vlow​ dá tdischarge=RCln⁡(VhighVlow)=RCln⁡(1−ββ)t_{discharge} = RC \ln \left( \frac{V_{high}}{V_{low}} \right) = RC \ln \left( \frac{1 - \beta}{\beta} \right)tdischarge​=RCln(Vlow​Vhigh​​)=RCln(β1−β​). O período total é, portanto, T=2RCln⁡(1−ββ)T = 2 RC \ln \left( \frac{1 - \beta}{\beta} \right)T=2RCln(β1−β​), e a frequência é f=1T=12RCln⁡(1−ββ)f = \frac{1}{T} = \frac{1}{2 RC \ln \left( \frac{1 - \beta}{\beta} \right)}f=T1​=2RCln(β1−β​)1​. Para o caso simétrico típico β=1/3\beta = 1/3β=1/3, isso simplifica para f≈0,72RCf \approx \frac{0,72}{RC}f≈RC0,72​, como ln⁡(2)≈0,693\ln(2) \approx 0,693ln(2)≈0,693.[56]

Na conversão analógico-digital, os comparadores formam o núcleo dos ADCs flash, permitindo a quantização de sinais analógicos em alta velocidade. Um flash ADC emprega comparadores 2n − 12 ^ n - 12n − 1, cada um referenciando uma derivação de tensão exclusiva de uma escada divisora ​​resistiva que abrange a faixa de entrada, para comparar simultaneamente o sinal de entrada com esses níveis. As saídas do comparador produzem um código de termômetro – uma representação unária onde as saídas acima do nível de entrada são altas e abaixo são baixas – indicando o compartimento de quantização. Esse código é então convertido em binário de n bits por meio de um codificador, permitindo taxas de conversão rápidas de até gigasamples por segundo, embora ao custo de um crescimento exponencial de hardware com resolução; por exemplo, um flash ADC de 8 bits requer 255 comparadores.

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